超大规模集成电路工艺原理 · LN7 · 课堂讲义
THERMAL OXIDATION

热氧化
从界面反应到先进器件

把一层 SiO2 长得“刚刚好”:反应、扩散、厚度控制与界面质量。

Si / SiO2 界面Deal–Grove 模型工艺控制
适用对象:微电子 / 集成电路专业大学三年级
01 / ROUTE
ROADMAP

学习路线

01 · 为什么氧化

理解 SiO2 在硅工艺中的定位:绝缘、界面与工艺缓冲。

02 · 如何长出来

从界面反应出发,掌握干氧、湿氧和炉管流程。

03 · 如何算厚度

用 Deal–Grove 模型解释线性段和抛物线段。

04 · 如何控质量

把厚度、均匀性、界面陷阱和电荷纳入控制窗口。

05 · 如何面对缩放

理解高 κ / 金属栅与 GAA 中“超薄界面层”的新角色。

06 · 课堂推演

根据目标厚度、质量和热预算选择工艺路径。

操作提示:方向键或 PageUp / PageDown 翻页,按 M 打开章节导航,按 F 进入全屏,按 N 显示讲解提示。

02 / POSITION
PROCESS POSITION

为什么硅工艺离不开 SiO2

原位生长

热氧化不是“贴膜”,而是消耗表面硅并形成 SiO2。界面来自同一个晶圆表面。

高质量界面

优良的 Si / SiO2 界面是硅 CMOS 历史上最关键的材料优势之一。

工艺缓冲层

垫氧、牺牲氧化层、场氧、隔离和清洗后界面修复都依赖可控氧化。

从主角到界面层

先进逻辑栅介质转向高 κ / 金属栅,但超薄界面氧化层仍影响 EOT、迁移率与可靠性。

热氧化的工艺定位

1
表面准备

洁净、低颗粒、低金属污染

2
受控生长

温度、气氛、时间、压力

3
薄膜评价

厚度、均匀性、界面、电学

核心问题:需要的是“快”,还是“致密且精确”?
03 / REACTION
REACTION

界面反应:干氧与湿氧

干氧:慢,但致密

Si + O2 → SiO2

适合较薄、质量要求高的氧化层。氧化剂穿过已有 SiO2 后,在移动界面处继续反应。

氧原子并不是只堆在表面:反应前沿会向硅内部移动。
干氧与湿氧通过氧化层扩散并在硅界面反应的无文字科学插图
O2:干氧
H2O:湿氧
已有 SiO2
移动反应界面
04 / FURNACE
FURNACE FLOW

炉管热氧化:一条可控流程

无文字石英炉管热氧化设备插图

交互:点击步骤,讨论每一步如何影响颗粒、均匀性、热预算和重复性。

05 / PHYSICS
DEAL–GROVE PHYSICS

Deal–Grove:三个串联过程

气相氧化剂:O2 或 H2O
穿过已有 SiO2:扩散阻力随厚度增加
Si / SiO2 界面:化学反应
晶体硅:被逐步消耗

关键直觉

薄氧化层时,界面反应更容易成为瓶颈;厚氧化层时,氧化剂穿越已有氧化层更困难,扩散逐渐主导。

h气相传质
D / xox氧化层内扩散
ks界面反应
模型把复杂过程压缩为可用于工艺设计的两个参数:A 与 B。
06 / EQUATION
MODEL EQUATION

Deal–Grove 方程:厚度随时间增长

xox2 + A xox = B (t + τ)
xox = A/2 [ √(1 + 4B(t+τ)/A2) − 1 ]

xox

氧化层厚度

B / A

线性速率常数

B

抛物线速率常数

τ

已有初始氧化层对应的时间平移

单位检查:若 xox 用 μm、t 用 h,则 B 的单位为 μm2/h,B/A 的单位为 μm/h。

07 / CURVE LAB
INTERACTIVE CURVE LAB

交互曲线:气氛、温度和时间

1000 °C
60 min

曲线采用 900–1100 °C 的代表性 Deal–Grove 常数作教学插值。实际量产必须以本机台、本晶圆和本配方的标定数据为准。

08 / REGIMES
LIMITING REGIMES

两种极限:线性段与抛物线段

薄氧化层:线性阶段
xox ≪ A ⇒ xox ≈ (B/A)(t+τ)

氧化剂穿过薄膜不困难,界面反应贡献更突出。厚度近似随时间线性增加。

厚氧化层:抛物线阶段
xox ≫ A ⇒ xox ≈ √[B(t+τ)]

氧化剂需要穿过越来越厚的 SiO2,扩散阻力增大。后续生长逐渐变慢。

课堂判断:同样增加 30 min,为什么 20 nm 薄氧和 500 nm 厚氧的增量不会相同?

09 / VOLUME
VOLUME EXPANSION

氧化不是沉积:硅会被消耗

500 nm
氧化前硅表面
SiO2
Si
xSi, consumed ≈ 0.44 xox
Δhabove surface ≈ 0.56 xox

500 nm 氧化层

约消耗 220 nm 硅,约有 280 nm 位于原始表面之上。

体积膨胀约为 2.27 倍。局部几何形貌和应力会让二维结构中的生长更复杂。

10 / KNOBS
PROCESS KNOBS

影响生长速率的六个旋钮

11 / CONTROL LOOP
CONTROL LOOP

工艺控制:从配方到厚度闭环

01 清洗颗粒 / 金属 / 有机物
02 装片舟位 / 间距 / 方向
03 稳温升温 / 等待 / 均温区
04 生长气氛 / 流量 / 时间
05 结束吹扫 / 退火 / 降温
06 测量椭偏 / 反射 / mapping
07 反馈漂移补偿 / SPC

批式炉管

适合多片晶圆、较厚氧化和高吞吐量场景。重点关注舟内位置、径向均匀性与历史累积。

快速热氧化 RTO

短时高温、热预算更低,常用于薄层或需要更精细瞬态控制的场景。设备温度瞬态和片内均匀性更关键。

控制对象不只是“平均厚度”:还包括片内、片间、批间均匀性和长期漂移。
12 / QUALITY
OXIDE QUALITY

氧化层质量:厚度只是第一关

金属 / 多晶硅
SiO2
Si
++ +

评价维度

厚度与均匀性、界面态密度、固定电荷、可动离子、陷阱、漏电、击穿场强和可靠性统计。

交互:点击电荷类型,观察其可能出现的位置。工艺清洁度、退火条件和界面处理都会改变电学表现。

13 / APPLICATIONS
APPLICATION MAP

应用地图:同一种氧化层,不同任务

栅介质 / 界面层

经典 MOS 栅氧;先进器件中承担超薄界面工程角色。

垫氧 Pad oxide

缓冲应力,常与氮化硅掩膜协同使用。

牺牲氧化层

生长后去除,带走表面损伤或污染,改善后续界面。

场氧 / LOCOS

历史上用于隔离;现代主流逻辑隔离转向 STI,但教学价值仍高。

侧壁与沟槽界面

修复刻蚀损伤,调节几何尺寸和界面状态。

掩膜与工艺保护

在扩散、注入或后续流程中提供缓冲和保护。

SiC 功率 MOS

SiO2 / SiC 界面质量仍是性能与可靠性关键之一。

量测与校准样片

通过可重复氧化和 mapping 建立设备基线。

14 / FRONTIER
ADVANCED DEVICES

先进逻辑:SiO2 从栅介质变为界面工程

经典平面 MOS

热 SiO2 可直接承担栅介质角色。

高 κ / 金属栅

为了降低等效氧化层厚度 EOT 与栅漏电,栅叠层演进为“超薄界面层 + 高 κ 介质 + 功函数金属”。

GAA 纳米片

环绕沟道的共形栅叠层提升静电控制。界面质量、EOT 和三维均匀性更加敏感。

无文字先进纳米片环绕栅叠层和碳化硅界面科学插图

前沿更新:TSMC 官方 N2 页面以 nanosheet transistors 描述其 2 nm 逻辑平台;imec 已展示面向 GAA 沟道的先进高 κ / 金属栅叠层,其结构包含界面氧化层、高 κ 介质和功函数金属层。

15 / LIMITS
MODEL BOUNDARIES

模型边界:什么时候不能只套公式

初始超薄阶段

极薄氧化早期可能偏离经典 Deal–Grove 近似;尤其干氧初始阶段更复杂。

二维形貌与应力

沟槽、侧壁、角部和局部应力会改变扩散与反应,LOCOS 鸟嘴是典型教学案例。

高掺杂与晶向

掺杂、晶向和表面状态会让标准参数失准,需要本地实验标定。

高压、RTO 与等离子体

工艺条件改变后,温度瞬态、分压和反应机制可能需要更细致模型。

先进栅叠层

超薄界面层、高 κ、金属和后续退火共同决定 EOT 与可靠性。

工程结论

模型用于建立直觉;量产窗口必须来自机台数据、量测和统计过程控制。

16 / DECISION GAME
CLASSROOM DECISION

课堂推演:为目标选择工艺路径

判断框架

问题需要权衡
目标厚度?薄层精度 vs 厚层吞吐量
质量目标?界面、致密性、电学可靠性
热预算?炉管批处理 vs RTO 瞬态控制
后续流程?去除、保留、叠层或再退火
17 / CHECKPOINT
CHECKPOINT

随堂检查:四个必须说清的问题

点击任意问题,显示要点。

18 / SUMMARY
SUMMARY

总结、资料与课后复盘

带走五句话

  • 热氧化是消耗硅形成 SiO2 的界面反应,不是简单沉积。
  • 干氧较慢但适合薄而高质量;湿氧较快,常用于较厚氧化。
  • Deal–Grove 用 A、B、τ 把反应和扩散合并为可用模型。
  • 薄层近似线性、厚层近似抛物线;工程上必须结合标定和 SPC。
  • 先进 GAA / 高 κ 金属栅中,SiO2 的角色转向超薄界面工程

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